Diseño de un codificador y decodificador digital Reed-Solomon usando programación en VHDL
En este artículo se presenta un procedimiento práctico para el diseño de un codificador/decodificador Reed-Solomon a través de la descripción funcional usando lenguaje descriptor de hardware (VHDL) con la herramienta de programación X...
Autor principal: | |
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Publicado: |
Universidad Nacional de Ingeniería (UNI) en Managua
2011
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NEXO3932019-02-04T15:47:05Z Diseño de un codificador y decodificador digital Reed-Solomon usando programación en VHDL Cecilia Sandoval, Cecilia codificador Reed-Solomon diseño de hardware VHDL En este artículo se presenta un procedimiento práctico para el diseño de un codificador/decodificador Reed-Solomon a través de la descripción funcional usando lenguaje descriptor de hardware (VHDL) con la herramienta de programación Xilinx ISE 9.2i. Este trabajo propone un diseño que usa los beneficios que presenta la programación VHDL, su característica de modularidad, y la estrategia de seccionar el diseño en componentes menos complejos para facilitar el proceso. Además, se detalla la metodología del diseño del decodificador a través de procesamiento paralelo. Para la validación del comportamiento del codificador/decodificador, se realizaron simulaciones con el programa ModelSim XE 5.7c.Palabras claves: codificador Reed-Solomon; diseño de hardware; VHDL Universidad Nacional de Ingeniería (UNI) en Managua 2011-06-02 info:eu-repo/semantics/article info:eu-repo/semantics/publishedVersion Peer-Reviewed Article Artículo revisado por pares application/pdf https://www.camjol.info/index.php/NEXO/article/view/393 10.5377/nexo.v21i01.393 Nexo Scientific Journal; Vol. 21 No. 01 (2008); 2-10 Nexo Revista Científica; Vol. 21 Núm. 01 (2008); 2-10 1995-9516 1818-6742 spa https://www.camjol.info/index.php/NEXO/article/view/393/260 |
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En este artículo se presenta un procedimiento práctico para el diseño de un codificador/decodificador Reed-Solomon a través de la descripción funcional usando lenguaje descriptor de hardware (VHDL) con la herramienta de programación Xilinx ISE 9.2i. Este trabajo propone un diseño que usa los beneficios que presenta la programación VHDL, su característica de modularidad, y la estrategia de seccionar el diseño en componentes menos complejos para facilitar el proceso. Además, se detalla la metodología del diseño del decodificador a través de procesamiento paralelo. Para la validación del comportamiento del codificador/decodificador, se realizaron simulaciones con el programa ModelSim XE 5.7c.Palabras claves: codificador Reed-Solomon; diseño de hardware; VHDL |
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